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Efficient Polynomial Multiplication for HQC on ARM Cortex-M4
- 1.Cortex-M4에서 HQC 다항식 곱셈 가속화하는 Hybrid FAFFT-CRT 제안, FAFFT 변환 길이를 절반으로 축소
- 2.2-way Karatsuba 기반의 Hybrid Karatsuba-FAFFT도 함께 제안하고 HQC에 radix-16 곱셈을 최초 적용
- 3.Cortex-M4 보드에서 HQC-1·HQC-3 다항식 곱셈 사이클을 각각 36.0%, 29.3% 감소
- 4.HQC-1 키생성·캐프슬화·디캐프슬화 사이클을 25.5%, 26.1%, 23.5% 감소해 종합 성능 개선
왜 중요한가?
NIST 표준화 후보 HQC의 임베디드 마이크로컨트롤러 연산 비용을 크게 낮춰, 사물인터넷·스마트카드 등 저전력 환경에서 포스트양자 암호 실전 배포의 진입장벽을 낮춘다.
언급 프로젝트
본문 미리보기
In this paper, we propose the Hybrid FAFFT-CRT method for accelerating HQC polynomial multiplication on the ARM Cortex-M4. The method uses the Chinese Remainder Theorem to map the polynomial ring to a product of an FAFFT-friendly ring of size $2^{d+1}$ and a small-degree residual ring, reducing the FAFFT transform length by half compared to the state-of-the-art. We also present the Hybrid Karatsuba-FAFFT method as an alternative hybrid based on a 2-way Karatsuba split, and apply radix-16 multipl
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